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    Cyclone V FPGA:降低系统成本和功耗



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    Altera的Cyclone® V FPGA实现了业界最低的系统成本和功耗,其性能水平使得该器件系列成为突出您大批量应用优势的理想选择。与前几代产品相比,总功耗降低了40%,具有高效的逻辑集成功能,提供集成收发器型号以及具有基于ARM的硬核处理器系统(HPS)的SoC FPGA型号。

    业界领先的低功耗和系统低成本特性

    该器件采用了TSMC的28-nm低功耗(28LP)工艺进行开发,对于成本敏感的应用,降低了功耗和成本。

    总功耗比Cyclone IV GX FPGA低40%

    功耗最低的串行收发器,每通道在5 Gbps时最大功耗88-mW。

    处理性能超过4,000 MIPS (Dhrystones 2.1基准测试),功耗不到1.8 W (对于SoC FPGA)。

    较多的使用了硬核知识产权(IP)模块,降低了功耗。

    还降低了成本——FPGA只需要两路电源稳压器电压,提供具有小外形封装选择的线键合封装。

    丰富的硬核IP模块

    由于Cyclone V FPGA集成了丰富的硬核IP模块,因此,您能够以更低的系统总成本和功耗以及更短的设计时间完成更多的工作,从而突出产品优势。关键硬核IP模块包括:

    支持Mobile DDR、LPDDR2 SDRAM和400-MHz DDR3 SDRAM的增强存储器控制器,提供可选纠错码(ECC)支持。

    提供多功能支持的PCI Express® Gen2

    精度可调数字信号处理(DSP)模块

    HPS (对于SoC FPGA):

    双核ARM CortexTM-A9 MPCoreTM处理器

    嵌入式外设(以太网、USB、闪存,等)

    宽带(>100 Gbps) HPS-FPGA互联

    为保护您宝贵的IP投入,Cyclone V FPGA还提供最全面的设计保护功能,包括支持易失和非易失密钥的256位高级加密标准。


    CycloneV Applications.pdf




    该器件采用了TSMC的28-nm低功耗(28LP)工艺进行开发,对于成本敏感的应用,降低了功耗和成本。
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  • 评选流程
  • 2012年6-8月方案提交
    2012年9-11月中电网注册工程师评选
    2012年11月评审委员会专家评选
    2013年01月18日颁奖典礼 (工信部微电子发展研究中心多功能会议室,北京)
  • 评选标准
  • 本次优秀方案评选,将从如下4个方面进行考评,邀请网友投票:
    • 方案的创新性
    • 方案性价比
    • 方案易用度
    • 方案市场潜力
 
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